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HI简历
18800000000hi@hicv.cn
应届生安徽省合肥市高新区模拟IC设计工程师
个人总结
意向岗位为模拟IC设计工程师。主修微电子科学与工程、集成电路设计与集成系统等课程,熟悉Cadence进行运放、基准源与电源管理模块的原理图设计、仿真验证与版图迭代。在课程项目中完成两级运放与带隙基准的指标拆解、参数扫描和结果复盘,能结合工艺角与功耗约束调整电路参数,注重设计文档与数据记录。
教育经历
示例大学
2023年09月-2027年06月
微电子科学与工程、集成电路设计与集成系统、电子科学与技术 本科 本科
示例大学微电子科学与工程专业,修读模拟集成电路设计、半导体器件物理、集成电路工艺等课程。课程项目完成两级运算放大器设计与仿真,覆盖增益、相位裕度与功耗指标,使用Cadence完成原理图与版图初版,并整理仿真报告。
工作经历
某模拟芯片设计团队
2025年03月-2025年06月
模拟IC设计实习生 模拟电路组
参与一款低压差线性稳压器(LDO)模块的前期调研与仿真验证:协助整理环路稳定性与电源抑制比(PSRR)指标需求,收集竞品数据手册并汇总对比表;在导师指导下用Cadence Virtuoso搭建测试台,对相位裕度、负载瞬态等指标做参数扫描与记录;与版图工程师沟通寄生参数对仿真结果的影响,跟进问题清单;每周参与组内评审并沉淀仿真记录文档。
项目经历
两级运算放大器课程设计
2024年09月-2025年01月
课程项目负责人
课程《模拟集成电路设计》综合项目,目标是在给定0.18μm CMOS工艺下设计满足增益与功耗约束的两级运放。负责整体架构选型与指标拆解,用Cadence完成原理图与AC、瞬态仿真,采用米勒补偿调整相位裕度,并做工艺角(TT/SS/FF)与温度扫描。与同组两人分别负责偏置电路和版图初稿,通过组内评审统一接口。最终在典型工艺角下直流增益约72dB、相位裕度约62°、静态功耗约1.2mW,满足课程设定的指标要求。
带隙基准源个人仿真项目
2023年10月-2024年05月
个人项目
个人自学的模拟模块练习项目,基于公开教材电路结构,在0.18μm工艺下搭建一阶曲率补偿带隙基准源。独立完成原理图绘制、启动电路设计与温度扫描仿真,用Cadence ADE记录-40℃至125℃范围内的输出曲线,并对比不同电阻比例对温漂的影响。为验证鲁棒性,补充电源电压±10%扰动下的仿真。测试口径为仿真环境、典型工艺角,结果显示温漂系数约25ppm/℃,电源抑制在低频段约-60dB;
社团和组织经历
学生发展中心
2023年09月-2024年06月
项目与活动负责人 学生组织
作为校电子设计协会模拟方向负责人,我牵头组织每月一次的技术沙龙,围绕运放、基准源等模块设计展开案例研讨,并邀请研究生学长分享流片经验。同时负责协会元器件与EDA工具资源管理,整理仿真模型库和设计检查清单,帮助低年级成员快速上手Cadence仿真流程。
荣誉奖项
校级优秀学生
《模拟集成电路设计》课程项目优秀成果
其他
- 技能: 熟悉Cadence Virtuoso与ADE仿真环境,能独立完成运放、基准源等模拟模块的原理图搭建与AC、瞬态仿真;掌握工艺角与温度扫描的仿真设置方法。; 掌握两级运放、带隙基准与LDO等基础模拟模块的指标拆解与参数调试,能结合增益、相位裕度、功耗约束迭代电路参数并记录仿真结果。; 了解0.18μm CMOS工艺器件特性与版图寄生对电路性能的影响,能与版图工程师沟通匹配、走线与寄生提取等基本问题。
- 证书: CET-6
- 语言: 英语:CET-6,可阅读模拟电路英文文献与EDA工具文档;普通话:二级甲等。
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