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HI简历
18800000000hi@hicv.cn
应届生泉州市通信研发工程师
个人总结
意向岗位为通信研发工程师,通信工程专业2027届本科毕业生。课程项目中使用MATLAB完成QPSK链路仿真与误码率分析,用Verilog编写数字电路模块并完成仿真验证,具备STM32嵌入式开发基础。在芯片验证方向做过功能覆盖率统计与测试用例整理,能对照设计文档定位问题并记录复现步骤。希望投递福建南方路面机械股份有限公司27秋招通信研发工程师方向,在半导体与集成电路相关项目中继续积累工程经验。
教育经历
示例大学
2023年09月-2027年06月
通信工程、电子信息工程、微电子科学与工程 本科 本科
主修通信原理、数字电路、信号与系统、微电子器件基础等课程。课程项目中完成数字调制解调链路仿真与误码率对比,独立编写Verilog模块并通过仿真波形核对逻辑功能,另参与嵌入式外设驱动调试,形成实验报告与测试记录。
工作经历
示例通信技术研发团队
2025年03月-2025年06月
通信研发实习生 嵌入式与信号处理组
参与通信模块的研发辅助工作,协助工程师整理链路参数与测试记录,使用MATLAB和示波器对基带信号做采样与频谱观察,配合硬件同事排查接口时序问题。在实验室测试环境下完成20组收发样例的误码统计,整理成测试记录表并提交复盘文档,帮助团队定位两处参数配置偏差。期间参与每周需求拆解会,负责信息收集与会议纪要沉淀,所有验证均在实验台完成,未涉及生产部署。
项目经历
数字基带收发链路课程设计
2024年09月-2025年01月
课程项目负责人
课程项目中负责搭建QPSK基带收发链路,用MATLAB完成调制解调与成形滤波仿真,并在FPGA开发板上做定点化验证。组织三人小组分工完成信道加噪、同步与误码统计模块,在实验室固定信噪比条件下测试2000帧样本,记录误码率随信噪比变化曲线,与理论值做对比分析,最终提交仿真报告与测试记录,并复盘定点位宽对结果的影响。
芯片验证流程个人实践
2023年10月-2024年05月
个人项目
个人项目中自学SystemVerilog与UVM基础,针对一个简化的FIFO模块搭建验证环境,编写激励与覆盖率收集脚本,在仿真工具中运行回归用例。围绕读写指针、满空标志设计定向与随机测试,统计功能覆盖点命中情况并整理验证报告,记录发现的边界条件问题及修正过程,形成可复用的验证笔记,为后续课程实验提供参考。
社团和组织经历
学生发展中心
2023年09月-2024年06月
项目与活动负责人 学生组织
在学院科创小组中负责通信类课程项目的进度协调,按周整理任务分工与实验记录,组织组内技术分享并汇总问题清单;协助实验室设备借用与耗材登记,保障课程项目按节点推进,锻炼了沟通协作与文档整理能力,也加深了对团队研发流程的理解。
荣誉奖项
校级优秀学生
课程实践项目优秀成果
其他
- 技能: 熟悉通信原理与数字电路基础,能用MATLAB搭建QPSK基带收发链路并完成误码率仿真与频谱观察。; 掌握Verilog与SystemVerilog基础语法,能编写数字模块并搭建UVM验证环境,完成定向与随机测试及覆盖率统计。; 熟悉STM32嵌入式开发流程,能完成外设接口调试、时序排查与测试记录整理,输出复盘文档。
- 证书: CET-6
- 语言: 英语:CET-6,可阅读通信与芯片相关英文技术文档;普通话:母语。
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