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求职者
版图设计工程师
13800000000candidate@example.com微电子科学与工程方向求职者北京市
个人总结
微电子科学与工程专业2026届本科生，参与过三个月版图设计实习，协助完成模拟单元版图绘制与DRC/LVS检查，记录并闭环常见问题。课程项目中负责两级运放版图布局与验证，关注匹配、对称与衬底接触处理。能使用Virtuoso和Calibre按检查清单核对结果，习惯记录修改过程，愿意在版图设计岗位持续积累。
教育经历
示例理工大学-微电子科学与工程本科本科
2022年09月-2026年06月
示例理工大学微电子科学与工程专业本科，2022年9月至2026年6月。主修半导体器件物理、CMOS集成电路设计、版图设计基础等课程，课程内容覆盖工艺流程与设计规则，为版图绘制和验证打下基础。
工作经历
示例公司-版图设计实习生 模拟电路设计部
2025年03月-2025年06月
参与模拟单元版图绘制与验证：依据原理图及工艺设计规则，使用Virtuoso完成布局布线，协助整理匹配与对称布局要点；用Calibre执行DRC/LVS检查并记录问题清单，与电路设计人员对接修改意见，按检查清单逐项核对并更新修改记录。实习期内所负责单元通过DRC/LVS检查，问题闭环率约90%，并沉淀一份版图检查操作记录。
项目经历
两级运算放大器版图设计与验证-课程项目成员
2024年09月-2025年01月
负责两级运放版图绘制与验证分工：梳理匹配与对称要求，采用共质心布局与保护环方案，使用Virtuoso完成版图绘制，用Calibre做DRC/LVS检查；与同组成员交叉核对版图与原理图一致性，迭代修复天线效应与衬底接触问题。课程验收中版图通过DRC/LVS检查，后仿增益与手工估算偏差约8%，形成版图设计报告一份。
基础标准单元版图搭建与特征化-课程项目负责人
2023年10月-2024年05月
负责6个基础标准单元版图任务拆分与进度协调：统一设计规则与命名规范，分配布局、布线、验证工作，使用Virtuoso与Calibre完成DRC/LVS检查，并配合特征化脚本提取延迟数据；组织组内交叉复核，记录问题与修改过程。课程验收中全部单元通过DRC/LVS检查，特征化数据与预期趋势一致，形成单元版图说明文档一份。
社团和组织经历
校内学生组织-学生组织成员 活动组
2023年09月-2024年06月
校电子设计协会成员，参与组织校内集成电路设计入门讲座与工具使用分享会，协助整理活动签到与资料归档，在小组活动中与同学分工完成版图练习的交叉检查。
荣誉奖项
校级课程项目优秀成果奖
校园集成电路设计竞赛小组三等奖
其他
- 技能: 熟悉CMOS工艺流程与版图设计规则，能使用Cadence Virtuoso完成单元级版图布局布线，并用Calibre进行DRC/LVS验证与问题定位; 掌握匹配、对称、保护环与衬底接触等版图布局要点，习惯按检查清单核对结果并记录修改过程，能与电路设计人员协作闭环评审意见
- 证书: 全国计算机等级考试二级
- 语言: 大学英语四级，具备阅读英文技术文档和工具手册的基本能力；普通话二级甲等。
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